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Technique et Science Informatiques

0752-4072
Revue des sciences et technologies de l'information
 

 ARTICLE VOL 24/10 - 2005  - pp.1227-1257  - doi:10.3166/tsi.24.1227-1257
TITRE
Méthodes de correction de retard dans les modèles RTL des systèmes monopuces DSP obtenus par assemblage de composants IP : fondement théorique et implémentation

RÉSUMÉ
Le principal problème d’une méthodologie de conception basée sur l’assemblage des composants IP préconçus et prévalidés est que le modèle RTL de l’architecture finale peut avoir un comportement défectueux. Cela est dû à des retards induits par des contraintes d’implémentation. Cet article présente la formalisation du problème et propose une méthode automatique de correction (correction de retard) pour le résoudre. Nous proposons deux algorithmes qui garantissent des solutions optimales en latence et en surface. La faisabilité de l’approche et l’optimalité des solutions proposées sont démontrées mathématiquement.

ABSTRACT
The principal problem of component-based design is that the behavior of the RTL model may be incorrect. This article presents the formalization of the problem and proposes an automatic correction method (called delay correction) to solve it. We propose two algorithms which perform the optimal solution in latency and area. The effectiveness of the approach and the optimality of the proposed solutions are mathematically proven.

AUTEUR(S)
Nacer-Eddine ZERGAINOH, Ludovic TAMBOUR, Henri MICHEL, Ahmed Amine JERRAYA

MOTS-CLÉS
correction de retard, système monopuce, DSP, conception système, assemblage automatique, DSP-IP paramétrable, modèle fonctionnel, RTL, théorie des graphes.

KEYWORDS
delay correction, SoC, DSP, system design, automatic assembly, DSP-IP-based, Generic DSP-IP, functional model, RTL, graph theory.

LANGUE DE L'ARTICLE
Français

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